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USB Type-A 的 5 V 与 D+/D− 两种防护区别在哪？
2026.11.09 00:00:00
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一台网络机顶盒的USB Type-A口做±8kV接触放电，打点在插座金属壳与面板的缝上。打完整机重启，同一个 U 盘换到旁边的口能认，这个口不认了，量 VBUS还是5.02V。拆机量D+对地12kΩ，正常应大于 1 MΩ。
直接答案
同一个插座里其实有两类线。VBUS 是 5 V 直流，只关心过压，按耐压选；D+/D− 是 480 Mbps 的差分信号，既要过压又要容值，按电容选。VBUS 用 5 V 档单向器件，VRWM 不低于 5.5 V；D+/D− 用 0.5 pF 以下的低容档。两颗可以共地，但不能指望一颗 5 V 四路阵列把四根线全兜住——阵列的公共地把 VBUS 的残压带进数据线，这正是上面那台机器 D+ 只剩 12 kΩ 的原因。
插座后面四根线，本来不是一类线
| 脚位/级 | 信号 | 正常电平 | 要不要加 | 原因 |
|---|---|---|---|---|
| VBUS（插座侧） | 5 V 直流，满载 1.5 A | 4.75～5.25 V | 要，5 V 档单向 | 后级 buck 的 SW 脚耐 18 V，余量够 |
| D+ | USB 2.0 差分，480 Mbps | 0～3.3 V | 要，0.5 pF 以下 | 容值超过 1 pF，眼图当场闭合 |
| D− | 与 D+ 配对 | 0～3.3 V | 要，同一颗的另一路 | 两路要对称，不能只保一根 |
| GND 与插座壳 | 回流与屏蔽 | 0 V | 不加器件，做搭接 | 壳地到主板地要低于 0.15 Ω |
| 面板弹片 | 屏蔽与放电入口 | 浮空或单点接地 | 不加，串 0 Ω 或 1 nF | 直接短接会把放电电流引进信号地 |
5V那边看耐压，数据那边看电容
VBUS 的后级是同步 buck，SW 脚绝对最大额定 18 V。5 V 档器件在 30 A、8/20 µs 波形下钳位 12 V，落在 18 V 以内，余量 6 V，这条线选型没有争议。麻烦在 D+/D−：后级 hub 芯片的绝对最大额定是 VCC 加 0.3 V，也就是 3.6 V，同一颗 5 V 档器件在 30 A 下同样钳 12 V，超了 8.4 V。差额只能用串联阻抗吃掉。串 47 Ω 时 (12 − 3.6) / 47 约 180 mA，落在 hub 内部 ESD 管能承受的 300 mA 以内；而 480 Mbps 的位宽是 2.08 µs，47 Ω 配 8 pF 负载的上升沿约 0.4 µs，还有五倍余量。串 22 Ω 就只有 380 mA，超了，这就是很多方案打一次好一次坏的原因。
器件贴插座，地要单独回插座
位置比型号更容易出错。器件必须放在插座焊盘后 5 mm 以内，走线先经过器件再进滤波与串阻，不能先串阻再并器件——先串阻的话，放电电流已经进了电阻，钳位就成了摆设。地的处理更要紧：TVS 的地要打过孔直接落到插座下面的地铜，不能拉到板子中部的数字地。插座地与大板地之间用两条 0.1 mm 弹片压接，实测 0.15 Ω，同一个 ±8 kV 打点，D+ 上的残压从 300 V 降到 42 V。四路阵列还有一个坑：公共地脚只有一个，VBUS 的浪涌会从这个脚抬升整片地，把另外三路的钳位点一起抬高 1.5～2 V，所以 VBUS 与数据线最好分两颗器件，各自回地。
复测看三个值，不看能不能点亮
第一步打插座缝、插芯、金属壳三个点，各 ±8 kV 接触 10 次；第二步打 ±15 kV 空气 10 次，对着插芯正对。判据三条：D+ 与 D− 对地漏电流小于 1 µA，VBUS 在打点瞬间跌落小于 0.3 V，U 盘枚举时间小于 2 s。漏电流这条最容易漏，很多板子打完了能认盘，放一天之后又不认，就是漏电流从 1 µA 涨到 20 µA，上拉被拉低。第三步把器件拆掉重打一遍做对照，确认残压确实是器件挡下来的，而不是走运没打到芯片。
常见问题
一颗四路阵列能不能把四根线全包住？
能包过压，包不住容值，也包不住地回流。四路阵列的单路结电容通常 1.5 pF 以上，挂在 480 Mbps 上眼图就没了；而且公共地把 VBUS 的残压耦合到数据脚，等于把两条本来独立的通路并成一条。正确做法是 VBUS 一颗单向、D+/D− 一颗低容双向，各自回地。
5 V 档换成 3.3 V 档是不是更保险？
反过来。3.3 V 档的 VRWM 只有 3.3 V，VBUS 常态 5 V 就已经超过它，器件长期处在导通边缘，漏电流从纳安级涨到几十微安，几个月后插上 U 盘就发热。选型的第一条是 VRWM 大于接口最高稳态电平并留 10% 余量，这条不满足，钳位再低也没用。
资料来源
资料核对日期：2026-11-09。绝对最大额定取自该机型 buck 与 hub 规格书，换方案后需按新的后级器件重算窗口；串阻取值受 480 Mbps 上升沿约束，不要大于 68 Ω。
上一条
